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PCB阻抗测试条带设计与TDR验证指南

阻抗测试条带(coupon)设计最佳实践——TDR测试原理、条带布局规则、IPC标准要求及常见问题。

为什么需要阻抗测试条带

控制阻抗PCB的生产中,设计师指定了走线的目标特性阻抗(如50Ω单端、100Ω差分),制造商必须验证实际产品是否达到这些目标值。但直接测量产品板上的走线既不实际(走线两端连接元件),也可能损坏产品。

解决方案是阻抗测试条带——与产品同时制造在同一面板上的专用测试结构。条带走线与产品走线共享相同的铜厚、介质厚度、蚀刻工艺和层压条件,因此其阻抗直接代表产品走线的阻抗。

IPC标准要求

IPC-6012(刚性PCB性能规范)和IPC-2141(控制阻抗PCB设计指南)规定:

参数IPC要求
测试条带数量每面板至少1条(建议2条)
条带走线长度最少150mm(6英寸)
阻抗公差如设计文件规定(默认±10%)
测试方法TDR(IPC-TM-650 2.5.5.7)
报告每批次提供阻抗测试报告

TDR测试原理

基本工作原理

TDR(时域反射仪)的工作原理类似于雷达:

  1. 发送:向被测走线发送一个快速阶跃电压信号(上升时间通常20-40ps)
  2. 传播:信号沿走线传播,如果遇到阻抗不连续点,部分能量被反射
  3. 接收:TDR记录反射信号随时间的变化
  4. 计算:根据反射系数ρ计算阻抗

反射系数公式:

ρ = (Z_load - Z_source) / (Z_load + Z_source)

局部阻抗计算:

Z(t) = Z₀ × (1 + ρ(t)) / (1 - ρ(t))

其中Z₀是TDR系统阻抗(通常50Ω)。

TDR波形解读

TDR波形是阻抗随走线长度(时间轴转换为距离轴)的分布图:

  • 平坦区域:阻抗均匀,走线特性阻抗恒定
  • 向上尖峰:阻抗增加(走线变窄、介质变厚、铜距参考面更远)
  • 向下尖峰:阻抗减小(走线变宽、介质变薄、铜距参考面更近)
  • 振荡:连接器或探针引入的寄生效应

空间分辨率

TDR的空间分辨率取决于阶跃信号的上升时间:

分辨率 ≈ t_rise × v_propagation / 2

典型值:

  • 40ps上升时间 → 分辨率约3mm
  • 20ps上升时间 → 分辨率约1.5mm
  • 10ps上升时间 → 分辨率约0.75mm

对于大多数PCB阻抗测试,20-40ps上升时间足够。更精细的分辨率需要更昂贵的TDR设备。

测试条带设计指南

走线参数

条带走线必须精确匹配产品走线的以下参数:

参数要求
层对(信号层+参考层)与产品完全相同
走线宽度与产品目标宽度相同
铜厚与产品相同(同层)
介质材料和厚度与产品相同(同叠层位置)
差分对间距与产品差分对间距相同

条带走线长度

走线长度必须足够长,以便TDR信号在连接器过渡效应消失后有足够的”稳态”传播区域用于测量:

测试类型最短走线长度推荐走线长度
单端阻抗100mm150-200mm
差分阻抗100mm150-200mm
插入损耗(需要两端口)150mm200-300mm

发射/接收焊盘设计

TDR探头或SMA连接器需要与条带走线良好连接。焊盘设计直接影响测量质量:

GSG(Ground-Signal-Ground)焊盘:用于单端阻抗测量

  • 信号焊盘:与走线等宽或略宽
  • 接地焊盘:连接到参考平面的过孔
  • 焊盘间距:匹配探针间距(通常0.5-1.0mm)

GSGSG焊盘:用于差分阻抗测量

  • 两个信号焊盘间距匹配差分对间距
  • 三个接地焊盘包围信号焊盘
  • 过渡区设计平滑,减少反射

参考平面要求

条带下方的参考平面必须:

  • 连续无开窗(除通孔反焊盘外)
  • 覆盖走线两侧至少3倍介质厚度的范围
  • 无走线或其他信号穿越
  • 通过多个过孔连接到测试焊盘的接地焊盘

面板上的条带位置

条带位置对测量代表性至关重要:

  1. 推荐位置:面板长边的废料边框中,条带走线方向与面板长边平行
  2. 避免位置:面板角落(层压最不均匀的区域)
  3. 对称放置:面板两端各放一条,可检测面板级的叠层厚度梯度
  4. 远离铣切线:条带走线至少距面板外轮廓3mm

常见问题与解决方案

条带与产品阻抗不一致

原因:条带位于面板边缘,而产品走线在面板中心。层压过程中面板边缘的树脂流动特性与中心不同,导致介质厚度差异。

解决方案

  • 使用面板内条带(embedded coupon)——将条带放在面板中心的废料区域
  • 测量面板两端条带的平均值
  • 要求制造商提供叠层截面分析数据

发射端反射过大

原因:探头与条带焊盘之间的阻抗不匹配,产生过大的初始反射,可能掩盖走线本身的阻抗特征。

解决方案

  • 优化焊盘几何设计,使过渡区阻抗平滑
  • 使用更精细间距的探针
  • 在数据处理中使用去嵌入(de-embedding)技术

走线阻抗沿长度方向变化

原因:蚀刻不均匀导致走线宽度从一端到另一端渐变,或介质厚度因树脂流动不均匀而变化。

解决方案

  • 这实际上反映了产品走线的真实状态
  • 使用走线中段的平均值作为报告阻抗
  • 如果变化超过规格,需要调整工艺参数

差分阻抗测试的特殊考虑

差分对阻抗匹配测试比单端测试更复杂:

差分模式vs共模

TDR可以同时测量差分模式阻抗(Z_diff)和共模阻抗(Z_common):

参数典型目标公差
Z_diff(差分阻抗)100Ω±10%
Z_common(共模阻抗)25-30Ω参考
Z_odd(奇模阻抗)50ΩZ_diff/2

差分对对称性

差分阻抗测试还应评估对称性——两根走线的单独阻抗应尽可能匹配。不对称会将差分信号转换为共模噪声,降低信号完整性

Atlas PCB的阻抗测试

Atlas PCB使用Polar CITS系列TDR设备进行阻抗测试:

参数能力
TDR上升时间20ps
阻抗测量精度±1%
支持阻抗类型单端、差分、共面
标准公差±10%(可选±5%)
报告格式TDR波形 + 数值报告

每单控制阻抗订单都包含阻抗测试报告,附TDR波形截图。对于±5%严格公差的订单,我们在生产过程中进行中间测量以确保最终合格。

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相关指南:PCB阻抗控制指南 | 信号完整性设计指南 | 阻抗匹配差分对

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